Tanner Tools 是一款针对定制集成电路（IC）、模拟/混合信号（AMS）和MEMS设计的产品，包含多个工具，S-Edit可用于电路图编辑，T-Spice是电路分析与模拟，W-Edit可用于显示T-Spice模拟结果，L-Edit包括编辑布局图、自动布局布线、DRC、电路转化等功能，LVS则是用于版图和电路图对比的工具，完整集成的模拟设计流程，可以极大的缩短用户投入工作的时间，大大提高工程师的效率。该版本已经过完美破解，可永久免费使用全部功能。
【功能特点】
1、完整的IC设计捕捉环境
Tanner S-Edit是一个易于使用的设计环境，用于原理图捕获和设计输入。 它为您提供了处理最复杂的混合信号IC设计捕获所需的功能。 S-Edit与Tanner T-Spice，Analog FastSPICE™（AFS）或Eldo®仿真器，Tanner L-Edit IC布局工具以及Calibre®LVS和PEX工具紧密集成。 S-Edit通过优化您的生产率并加快将概念应用于硅的速度，可以帮助您满足当今快速发展的市场的需求。 更快的设计周期为您提供了向最佳解决方案过渡的更多灵活性，从而节省了更多时间和资源来进行工艺角确认。 结果是减少了下游风险，提高了产量并缩短了上市时间。
2、最复杂的混合信号IC设计的原理图捕获
总线支持加快了混合信号设计的创建
先进的阵列支持可轻松创建和编辑具有重复块的存储器，图像或电路
具有快速固定（热点）功能的橡皮筋连通性编辑功能可加快设计修改速度
S-Edit在设计过程中实时显示评估的参数； 可以显示或评估具有基于其他电路参数的公式的参数
自动生成符号使您可以轻松地从原理图创建符号并同步所有更改
所有操作均可通过TCL / Tk命令语言完全编写脚本
可记录的脚本使您能够自动化任务或扩展工具以满足特定于应用程序的需求
可重播的日志可在网络或硬件出现意外故障时进行恢复
S-Edit在突出显示层次结构时执行网络突出显示并保持网络突出显示
口径RVE在原理图，布局和LVS报告之间进行交叉探测以突出显示网络或设备
原理图ERC使您可以检查设计中是否存在常见错误，例如未驱动的网络，未连接的引脚以及由多个输出驱动的网络。 设计检查是完全可配置的，包括自定义验证脚本
3、与仿真紧密集成
从原理图捕获环境中驱动模拟器。 这样就可以直接在原理图上查看工作点结果，查看设备的小信号参数，查看模型参数以及执行波形交叉探测以查看节点电压以及设备端子电流或电荷。
S-Edit为电路设计，仿真，分析和调整的迭代循环创建了高效流程。 专注于设计而不是数据处理，从而加快了设计过程。
4、与第三方工具和旧版数据轻松互操作
S-Edit从第三方工具中以本机OpenAccess或EDIF进行读取，并自动转换原理图和属性以无缝集成遗留数据
网表可以以灵活的，用户可配置的格式导出，包括SPICE和CDL变体，EDIF，结构性Verilog 以及结构化的VHDL
S-Edit中的库支持最大限度地重用了以前项目中开发的或从第三方供应商处导入的IP
5、强大且易于使用的界面
S-Edit使前端设计的捕获更轻松，更高效
完全由用户可编程的设计环境使您可以重新映射热键，创建新的工具栏以及根据自己的喜好自定义视图-所有这些都在简化的GUI中
完整的用户界面 支持多种语言，包括英语，日语，简体中文和繁体中文
S-Edit提供Unicode支持； 所有用户数据都可以输入国际字符集。ird-PartyTools and Legacy Data
S-Edit从第三方工具中以本机OpenAccess或EDIF进行读取，并自动转换原理图和属性以无缝集成遗留数据
网表可以以灵活的，用户可配置的格式导出，包括SPICE和CDL变体，EDIF，结构性Verilog 以及结构化的VHDL
S-Edit中的库支持最大限度地重用了以前项目中开发的或从第三方供应商处导入的IP
6、具有成本效益
S-Edit提供了理想的性能成本比，使您可以最大化项目中的设计人员人数
由于S-Edit在Windows®和Linux平台上运行，因此设计人员可以在具有成本效益的工作站或 笔记本电脑 这意味着您可以随身携带您的工作，甚至在家中，也可以继续工作，以满足上市时间的压力
提供两种配置：完整的原理图编辑器和原理图查看器
【破解说明】
1、下载并安装源程序，打开crack破解文件夹，以管理员身份运行MentorKG.exe会自动生成许可证文件LICENSE.TXT，保存在一个指定位置，比如软件安装目录下；
2、创建系统环境变量：右键我的电脑—>属性—>高级系统设置—>环境变量
变量名：LM_LICENSE_FILE
变量值：指向License.txt路径
3、至此，软件成功激活。
